下列何種情況會導致 CPU 管道(pipeline)的管道阻塞(pipeline stall)?
A高頻寬度通訊
BCPU 核心數量增多
C指令順序正確無誤
D當一個指令正在等待從記憶體讀取資料時,下一個指令無法立即被解碼正確答案
答案與詳解
這是典型的資料相依性 (data hazard) 或記憶體延遲造成的 stall:後續指令需等待前一指令的資料回傳,管線只好插入氣泡 (bubble) 暫停。
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